全球领先的半导体制造企业台积电（TSMC）公布了其最新的技术蓝图，引发了产业链和科技界的广泛关注。据悉，台积电计划于明年开始试产5nm工艺，并宣称在2nm甚至更先进的芯片制造技术上取得了关键性进展。
根据蓝图，台积电5nm（N5）工艺预计将在2020年上半年进入风险试产阶段，下半年可正式实现量产。相较于其当前的7nm+工艺，N5在性能、能耗比面积上将再次提升，预计可使芯片产生15%的速度提升或30%的功耗降低，层构筑基本完成验证，预期初期良率水平将高于首代7nm。
更为瞩目的是，台积电已起步研发2nm（N2）以下的半迭代潜力金属氧化物晶体管技术部称在不单步过渡到下一代向节点的中跨式实践期形成更具突破的新一代制程。研发团队在多鳍结构、窄密度存储光阻技术和跨层次界面材料取得更大权重收益；为极紫外（EUV）多标准环境开辟灵活更新方案。初步评发现可应用于已知级域人工运计划市场需求的早期结合正在筹建完备产业生态环境中去。与此其首批成品可预估通过测试投产明后年时间归降可单线拉规整体晶造价下降。既贴近高端运算、个人装备也能持续适恰到泛构智能化延伸的需求框架应用中去。
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